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AD9985A
V D = 3.3 V, V DD = 3.3 V, ADC clock = maximum conversion rate, unless otherwise noted.
Table 2.
Test
AD9985ABSTZ-110
Parameter
Temp
Level
Min
Typ
Max
Unit
RESOLUTION
DC ACCURACY
8
Bits
LSB
Differential Nonlinearity
Integral Nonlinearity
25°C
Full
25°C
I
VI
I
±0.5
±0.5
+1.25/?1.0
+1.5/?1.0
±1.85
LSB
LSB
LSB
ANALOG INPUT
Input Voltage Range
Full
VI
±3.2
Minimum
Maximum
Gain Tempco
Input Bias Current
Input Offset Voltage
Full
Full
25°C
25°C
Full
Full
VI
VI
V
IV
IV
VI
1.0
100
7
0.5
1
2
V p-p
V p-p
ppm/°C
μA
μA
mV
Input Full-Scale Matching
Full
VI
1.5
8.0
% FS
Offset Adjustment Range
Full
VI
46
49
52
% FS
REFERENCE OUTPUT
Output Voltage
Temperature Coefficient
Full
Full
VI
V
1.25
±100
V
ppm/°C
SWITCHING PERFORMANCE
Maximum Conversion Rate
Minimum Conversion Rate
Full
Full
VI
IV
110
10
MSPS
MSPS
Data-to-Clock Skew
t BUFF
t STAH
t DHO
t DAL
t DAH
t DSU
t STASU
t STAH
HSYNC Input Frequency
Full
Full
Full
Full
Full
Full
Full
Full
Full
Full
IV
VI
VI
VI
VI
VI
VI
VI
VI
IV
?0.5
4.7
4.0
300
4.7
4.0
250
4.7
15
+2.0
110
ns
μs
μs
ns
μs
μs
ns
μs
μs
kHz
Maximum PLL Clock Rate
Minimum PLL Clock Rate
Full
Full
VI
IV
110
12
MHz
MHz
PLL Jitter
Sampling Phase Tempco
25°C
Full
Full
IV
IV
IV
400
15
700 1
1000 1
ps p-p
ps p-p
ps/°C
DIGITAL INPUTS
Input Voltage, High (V IH )
Input Voltage, Low (V IL )
Input Current, High (I IH )
Input Current, Low (I IL )
Input Capacitance
Full
Full
Full
Full
25°C
VI
VI
V
V
V
2.5
3
0.8
?1.0
1.0
V
V
μA
μA
pF
DIGITAL OUTPUTS
Output Voltage, High (V OH )
Output Voltage, Low (V OL )
Full
Full
VI
VI
V D ? 0.1
0.1
V
V
Duty Cycle, DATACK
Full
IV
45
50
55
%
Output Coding
Rev. 0 | Page 5 of 32
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